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實(shí)驗(yàn)課件
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科目：
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電路基礎(chǔ)實(shí)驗(yàn)
物理實(shí)驗(yàn)
模擬電子線路實(shí)驗(yàn)
電子系統(tǒng)設(shè)計(jì)
信號系統(tǒng)與處理
數(shù)字電子技術(shù)
通信與信息系統(tǒng)綜合應(yīng)用實(shí)驗(yàn)
片區(qū)：
全部
東北
華東
西北
華北
華中
華南
西南
鼎陽杯專區(qū)
高校：
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北京航空航天大學(xué)
北京航空航天大學(xué)
北京化工大學(xué)
北京化工大學(xué)
北京交通大學(xué)
北京交通大學(xué)
北京科技大學(xué)
北京信息科技大學(xué)
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大連交通大學(xué)
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東北大學(xué)
東北大學(xué)
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華中科技大學(xué)
華中科技大學(xué)
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空軍工程大學(xué)
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中國民航飛行學(xué)院廣漢分院
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重慶大學(xué)
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重慶師范大學(xué)
教師：
全部
秦慧平
賈院長
肖翮
2019年二等獎-單片機(jī)定時(shí)計(jì)數(shù)器“音樂盒”
所屬科目：
電子系統(tǒng)設(shè)計(jì)
署名者：
admin
學(xué)院名稱：
華南理工大學(xué)廣州學(xué)院(鼎陽杯專區(qū))
上傳時(shí)間：
2022-03-28
實(shí)驗(yàn)內(nèi)容：運(yùn)用單片機(jī)的定時(shí)/計(jì)數(shù)器模塊T0、T1、T2、T3和外部電路，設(shè)計(jì)“音樂盒”。 1）基礎(chǔ)實(shí)驗(yàn)： ①調(diào)試一個定時(shí)器 設(shè)計(jì)單片機(jī)程序
2019年二等獎-數(shù)字電子技術(shù)實(shí)驗(yàn)綜合-基于I2C存儲器實(shí)現(xiàn)
所屬科目：
電子系統(tǒng)設(shè)計(jì)
署名者：
admin
學(xué)院名稱：
南京工程學(xué)院(鼎陽杯專區(qū))
上傳時(shí)間：
2022-03-28
本實(shí)驗(yàn)是通過對邏輯電路、時(shí)序電路的綜合應(yīng)用,實(shí)現(xiàn)具有I2C通信功能的簡易存儲器；提高學(xué)生綜合應(yīng)用門電路、邏輯電路、時(shí)序電路的能力；學(xué)習(xí)典型功能數(shù)字芯片的邏輯
2019年一等獎（鼎陽杯）-數(shù)字系統(tǒng)的時(shí)間同步
所屬科目：
電子系統(tǒng)設(shè)計(jì)
署名者：
admin
學(xué)院名稱：
武漢大學(xué)(鼎陽杯專區(qū))
上傳時(shí)間：
2022-03-28
本實(shí)驗(yàn)涉及數(shù)據(jù)選擇器、計(jì)數(shù)器、時(shí)序邏輯電路、FPGA、衛(wèi)星授時(shí)馴服晶振等知識，綜合運(yùn)用硬件描述語言編程、信號測試、串行接口通信等技術(shù)。時(shí)間同步在通信、軍事、
2019年二等獎-直流減速電機(jī)轉(zhuǎn)速測量與控制電路的設(shè)計(jì)
所屬科目：
電子系統(tǒng)設(shè)計(jì)
署名者：
admin
學(xué)院名稱：
大連理工大學(xué)(鼎陽杯專區(qū))
上傳時(shí)間：
2022-03-28
這是一個運(yùn)用數(shù)字電子技術(shù)解決現(xiàn)實(shí)生活和工程實(shí)際問題的典型案例，需要運(yùn)用編碼器信號采集、組合邏輯電路、計(jì)數(shù)器與定時(shí)器、數(shù)字PID控制、PWM驅(qū)動、AXI總線接
2019年二等獎-智力競賽搶答裝置
所屬科目：
電子系統(tǒng)設(shè)計(jì)
署名者：
admin
學(xué)院名稱：
武警工程大學(xué)(鼎陽杯專區(qū))
上傳時(shí)間：
2022-03-28
智力競賽搶答裝置是一個運(yùn)用數(shù)字電子技術(shù)解決現(xiàn)實(shí)生活和工程實(shí)際問題的典型案例，需要運(yùn)用數(shù)據(jù)顯示、參數(shù)設(shè)定、等相關(guān)知識與技術(shù)方法。并涉及由555定時(shí)器和電阻電容
2019年二等獎-精簡指令集CPU設(shè)計(jì)與實(shí)現(xiàn)
所屬科目：
電子系統(tǒng)設(shè)計(jì)
署名者：
admin
學(xué)院名稱：
電子科技大學(xué)(鼎陽杯專區(qū))
上傳時(shí)間：
2022-03-28
實(shí)驗(yàn)使用可編程邏輯器件實(shí)驗(yàn)平臺，設(shè)計(jì)開發(fā)包括微處理器核心模塊的指令譯碼器、指令控制器、數(shù)據(jù)通路以及微處理器系統(tǒng)。需要運(yùn)用數(shù)字邏輯電路基礎(chǔ)理論知識及系統(tǒng)級數(shù)字
2019年一等獎-基于Verilog語言的函數(shù)信號發(fā)生器設(shè)計(jì)
所屬科目：
電子系統(tǒng)設(shè)計(jì)
署名者：
admin
學(xué)院名稱：
西安交通大學(xué)(鼎陽杯專區(qū))
上傳時(shí)間：
2022-03-28
該實(shí)驗(yàn)案例在大規(guī)?，F(xiàn)場可編程器件FPGA上采用硬件描述語言Verilog HDL設(shè)計(jì)了一個函數(shù)信號發(fā)生器。將DDS用于函數(shù)信號發(fā)生器的設(shè)計(jì)，通過搭積木的方式
2019年二等獎-基于SRAM的緩存控制器設(shè)計(jì)實(shí)驗(yàn)
所屬科目：
電子系統(tǒng)設(shè)計(jì)
署名者：
admin
學(xué)院名稱：
西安交通大學(xué)(鼎陽杯專區(qū))
上傳時(shí)間：
2022-03-28
相關(guān)知識：本實(shí)驗(yàn)涉及數(shù)據(jù)輸入、數(shù)據(jù)輸出、雙向通信、指令傳遞、地址管理、不同設(shè)備間的異步通信等問題。 應(yīng)用背景：無論是使用FPGA作為硬件算法處理，還是
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